等离子体CMOS工艺中应用于集成电路制造中WAT方法研究
等离子体cmos工艺中应用于集成电路制造中wat方法研究：
wat(wafer accept test)即硅圆片接收测试，就是在半导体硅片完成所有的制程工艺后，对硅圆片上的各种测试结构进行电性测试，它是反映产品质量的一种手段，是产品入库前进行的一道质量检验。
伴随着半导体技术的发展，等离子体工艺已广泛应用于集成电路制造中，离子注入、干法刻蚀、干法去胶、uv辐射、薄膜淀积等都可能会引入等离子体损伤，而常规的wat结构无法监测，可能导致器件的早期失效。等离子体工艺广泛应用于集成电路制造中，比如等离子体刻蚀、等离子体增强式化学气相淀积、离子注入等。它具有方向性好、反应快、温度低.均匀性好等优点。
但是它也同时带来了电荷损伤，随着栅氧化层厚度的不断降低，这种损伤会越来越影响到mos器件的可靠性，因为它可以影响氧化层中的固定电荷密度、界面态密度、平带电压、漏电流等参数。带天线器件结构的大面积离子收集区(多晶或金属)一般位于厚的场氧之上，因此只需要考虑薄栅氧上的隧道电流效应。大面积的收集区称为天线，带天线器件的隧道电流放大倍数等于厚场氧上的收集区面积与栅氧区面积之比，称为天线比。
如果栅氧区较小，而栅极面积较大，大面积栅极收集到的离子将流向小面积的栅氧区，为了保持电荷平衡，由衬底注人栅极的隧道电流也需要随之增加，增加的倍数是栅极与栅氧面积之比，放大了损伤效应，这种现象称为“天线效应”。对于栅注入的情况，隧道电流和离子电流之和等于等离子体中总的电子电流。因为电流很大，即使没有天线的放大效应，只要栅氧化层中的场强能产生隧道电流，就会引起等离子体损伤。
在正常的电路设计中栅端一般都需要开孔经多晶或金属互连线引出做功能输入端，就相当于在薄弱的栅氧化层上引入了天线结构，所以在正常流片及wat监测时所进行的单管器件电性测试和数据分析无法反映电路中实际的等离子体损伤情况。氧化层继续变薄到3nm以下，基本不用再考虑充电损伤问题，因为对于3nm厚度的氧化层而言，电荷积累是直接隧穿越过氧化层势垒，不会在氧化层中形成电荷缺陷。
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伴随着半导体技术的发展，等离子体工艺已广泛应用于集成电路制造中，离子注入、干法刻蚀、干法去胶、uv辐射、薄膜淀积等都可能会引入等离子体损伤，而常规的wat结构无法监测，可能导致器件的早期失效。等离子体工艺广泛应用于集成电路制造中，比如等离子体刻蚀、等离子体增强式化学气相淀积、离子注入等。它具有方向性好、反应快、温度低.均匀性好等优点。
但是它也同时带来了电荷损伤，随着栅氧化层厚度的不断降低，这种损伤会越来越影响到mos器件的可靠性，因为它可以影响氧化层中的固定电荷密度、界面态密度、平带电压、漏电流等参数。带天线器件结构的大面积离子收集区(多晶或金属)一般位于厚的场氧之上，因此只需要考虑薄栅氧上的隧道电流效应。大面积的收集区称为天线，带天线器件的隧道电流放大倍数等于厚场氧上的收集区面积与栅氧区面积之比，称为天线比。
如果栅氧区较小，而栅极面积较大，大面积栅极收集到的离子将流向小面积的栅氧区，为了保持电荷平衡，由衬底注人栅极的隧道电流也需要随之增加，增加的倍数是栅极与栅氧面积之比，放大了损伤效应，这种现象称为“天线效应”。对于栅注入的情况，隧道电流和离子电流之和等于等离子体中总的电子电流。因为电流很大，即使没有天线的放大效应，只要栅氧化层中的场强能产生隧道电流，就会引起等离子体损伤。
在正常的电路设计中栅端一般都需要开孔经多晶或金属互连线引出做功能输入端，就相当于在薄弱的栅氧化层上引入了天线结构，所以在正常流片及wat监测时所进行的单管器件电性测试和数据分析无法反映电路中实际的等离子体损伤情况。氧化层继续变薄到3nm以下，基本不用再考虑充电损伤问题，因为对于3nm厚度的氧化层而言，电荷积累是直接隧穿越过氧化层势垒，不会在氧化层中形成电荷缺陷。
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